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RISC-V
Il RISC-V (pronunciato: «risc-five»[1]) è uno standard aperto di insieme di istruzioni (ISA, dall'inglese instruction set architecture) basato sul principio reduced instruction set computer (RISC). A differenza di molti altri ISA, il RISC-V è pubblicato sotto licenza open source, pertanto non richiede l'acquisto di una licenza per essere utilizzato. Molte aziende offrono o hanno annunciato hardware basato su questo standard, alcuni sistemi operativi open source sono disponibili e l'insieme d'istruzioni è supportato da diversi toolchain.
Il progetto è iniziato nel 2010 all'Università della California - Berkeley, ma molti contributori sono volontari non affiliati all'istituto.[2] A differenza di altri design accademici, generalmente ottimizzati per la pura semplicità d'esposizione, i progettisti di questo standard hanno permesso che possa essere utilizzato per computer pratici.
A giugno 2019, le versioni 2.2 dello user-space dell'ISA[3] e 1.1 dell'ISA privilegiato[4] sono congelate, permettendo il proseguimento dello sviluppo di hardware e software. È disponibile la bozza della specifica di debug, alla versione 0.3.[4]
- ^ Waterman e Asanović, p. 1.
- ^ (EN) Contributors, su RISC-V International. URL consultato il 13 aprile 2020 (archiviato dall'url originale il 13 giugno 2018).
- ^ Waterman e Asanović.
- ^ a b (EN) Privileged ISA Specifications, su RISC-V International. URL consultato il 13 aprile 2020 (archiviato dall'url originale il 26 agosto 2018).
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